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硬體面試考題庫
類比/電源/數位/PCB/EMC 面試題與解析。完整題庫為付費解鎖。
免費試閱（2 題）
Q1. 去耦電容為何要靠近 IC 電源腳？
縮短電流迴路降低寄生電感，瞬態電流由近端電容供應、減少電源軌壓降與雜訊；小容值最靠腳、大容值稍遠。
Q2. 開漏輸出為何要上拉電阻？
開漏只能拉低、不能輸出高電位，需外接上拉到目標邏輯電壓才有高準位；阻值權衡速度(RC)與耗電。
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面試考題
類比/電源/數位/PCB/EMC 面試題與解析。完整題庫為付費解鎖。
縮短電流迴路降低寄生電感，瞬態電流由近端電容供應、減少電源軌壓降與雜訊；小容值最靠腳、大容值稍遠。
開漏只能拉低、不能輸出高電位，需外接上拉到目標邏輯電壓才有高準位；阻值權衡速度(RC)與耗電。